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核心職責(zé) 1.負(fù)責(zé)芯片物理驗(yàn)證流程（DRC/LVS）的實(shí)施與優(yōu)化，確保設(shè)計(jì)符合工藝規(guī)則和可靠性要求。 2.使用物理驗(yàn)證工具完成版圖驗(yàn)證，分析并解決驗(yàn)證過(guò)程中出現(xiàn)的復(fù)雜問(wèn)題。 3.與設(shè)計(jì)團(tuán)隊(duì)、工藝團(tuán)隊(duì)緊密協(xié)作，提供物理驗(yàn)證規(guī)則反饋，優(yōu)化版圖設(shè)計(jì)。 4.開(kāi)發(fā)自動(dòng)化腳本（Tcl/Python/Perl等）提升驗(yàn)證效率，優(yōu)化驗(yàn)證流程。 5.編寫(xiě)技術(shù)文檔，總結(jié)驗(yàn)證經(jīng)驗(yàn)，支持流片前的最終簽核（Sign-off）。 任職資格 1.教育背景：集成電路設(shè)計(jì)、半導(dǎo)體物理、微電子、電子工程等相關(guān)專(zhuān)業(yè)本科及以上學(xué)歷。 2.技能要求： 熟悉主流的物理驗(yàn)證工具(Calibre/Argus)及流程，精通DRC/LVS規(guī)則編寫(xiě)及調(diào)試。 理解并熟悉半導(dǎo)體制造工藝及相應(yīng)的設(shè)計(jì)規(guī)則。 掌握至少一種腳本語(yǔ)言（Tcl/Python/Perl等），具備自動(dòng)化開(kāi)發(fā)能力。 熟悉版圖設(shè)計(jì)工具（Virtuoso/Aether等）及數(shù)據(jù)格式（GDSII/OASIS）。 3.溝通與團(tuán)隊(duì)協(xié)作： 溝通能力：能夠清晰地與設(shè)計(jì)、測(cè)試和制造團(tuán)隊(duì)進(jìn)行溝通，協(xié)調(diào)解決跨部門(mén)的問(wèn)題。 團(tuán)隊(duì)協(xié)作能力：具備良好的團(tuán)隊(duì)合作意識(shí)，能夠與跨職能團(tuán)隊(duì)共同推動(dòng)項(xiàng)目進(jìn)展，解決設(shè)計(jì)和驗(yàn)證過(guò)程中遇到的復(fù)雜問(wèn)題。 經(jīng)驗(yàn)要求： 2年以上芯片物理驗(yàn)證相關(guān)經(jīng)驗(yàn)，有成功流片經(jīng)驗(yàn)者優(yōu)先。 有先進(jìn)工藝節(jié)點(diǎn)的物理驗(yàn)證經(jīng)驗(yàn)優(yōu)先。